Sí, leyó bien. Son 64 núcleos, no 64 bits. Tilera, una corporación de la que seguramente no escuchó hablar hasta ahora, es la autora de lo que tal vez se convierta en uno de los descubrimientos más importantes de la última decada en tecnología de microprocesadores. Pero a menos que tenga una granja de renderizado de imágenes tridimensionales, es poco probable que usted esté dispuesto a pagar 435 dólares por cada núcleo. ¿Cree que Tilera podrá hacerse un lugar en el mercado gracias a la innovación? ¿O terminará en convocatoria de acreedores como Transmeta?
Diseñar un núcleo es algo “relativamente sencillo”, pero hacerlo funcionar con otros elementos de cómputo ha sido siempre la parte más difícil. Intel ha logrado llevar a los procesadores de doble núcleo al escritorio gracias a su Core Duo ruteado a través un único bus. AMD, mientras tanto, utiliza la tecnología HyperTransport para lograr la comunicación entre sus núcleos. Algunos fabricantes han llevado esta tecnología más allá, lo que derivó en la creación de tecnologías como PCI-X e Infiniband. Pero si bien estas tecnologías están funcionando muy bien en arquitecturas de dos y cuatro núcleos, no son escalables para implementar chips con una mayor cantidad de elementos.
Tilera Corporation, una empresa fundada en el 2004 con sede en Silicon Valley, ha presentado su primer producto: el microprocesador multicore Tile64. Se trata del primer miembro de la familia Tile, los cuales estarían basados en una arquitectura revolucionaria capaz de soportar cientos e incluso miles de núcleos. La empresa planea desarrollar versiones de 36 y 120 núcleos próximamente.
La arquitectura en cuestión conecta cada uno de los núcleos a través de una red de entrada / salida. Lo interesante es que el diseño de los núcleos es bastante convencional: cada uno tiene caché de dos niveles, como si de un procesador convencional se tratase. A su vez, estos núcleos comparten una caché de nivel 3. Pero más interesante aún es que los núcleos han sido diseñados para ser utilizados con kernels de Linux con soporte para multiprocesamiento simétrico en su versión 2.6 o superior.
Cada núcleo RISC opera a una frecuencia de reloj de 600 o 900 MHz. e incluye una pequeña “red conmutada” a la que Tilera bautizó con el nombre de iMesh. Dicha red se encarga de distribuir los datos entre los núcleos. Cada núcleo y su red iMesh es un tile (teja o mozaico), un elemento de cómputo del procesador. Gracias a iMesh cada núcleo dispone de un ancho de banda de un terabit, eliminando la congestión del sistema de una forma eficiente.
Si un programador quisiera, podría “separar” un grupo de núcleos para dedicar su poder de cómputo a una tarea específica.
Tilera tampoco se anda con chiquitas en cuanto al subsistema de entrada / salida: cuatro controladores de memoria DDR2 y un conjunto completo de interfaces de alta velocidad que incluyen dos interfaces XAUI de 10 Gbps, dos conexiones PCIe de 10 Gbps, una interfaz Gigabit Ethernet y una interfaz programable con soporte para dispositivos como memorias Compact Flash y unidades de disco convencionales.
Fuente: Lucas Godoy. ITSitio.
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